Betriebssysteme (BS) im WS16
Inhalt der Vorlesung
Ziel der Vorlesung ist die Vermittlung von konzeptionellen Grundlagen und wichtigen Techniken, die fürr den Bau eines Betriebssystems erforderlich sich. In den vorlesungsbegleitenden Übungen werden diese Kenntnisse praktisch angewendet, indem ein kleines PC-Betriebssystem in kleinen Arbeitsgruppen von Grund auf neu entwickelt wird. Um dies zu bewerkstelligen, sind fundierte Kenntnisse über Aufbau und Funktionsweise der PC-Hardware erforderlich, die ebenfalls in der Lehrveranstaltung vermittelt werden. Dabei werden gleichzeitig Grundlagen aus dem Betriebssystembereich wie Unterbrechungen, Synchronisation und Ablaufplanung, die aus früheren Veranstaltungen (wie Softwaresysteme I oder Systemprogrammierung I) weitgehend bekannt sein sollten, wiederholt und vertieft.
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Inhalt der Übungen
Ziel der Übungen ist es, schrittweise ein eigenes kleines Betriebssystem (OOStuBS, Objektorientiertes Studenten-Betriebssystem, bzw. MPStuBS, MultiProzessorStudenten-Betriebssystem) für den PC zu entwickeln. Dafür werden Gruppen aus je zwei Studenten gebildet.
Wichtig: Bitte meldet euch für die Übungen an. Dies ist ab sofort über Waffel möglich.
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Dozenten und Betreuer
Terminübersicht (Stundenplan)
Terminübersicht (Semesterplan)
Hier ist der geplante Ablauf der Übungen für BS im Überblick dargestellt: Zu jeder Aufgabe gibt es jeweils eine Tafelübung (TÜ) an zwei Terminen. Die Abgabe der Aufgaben findet im Rahmen der Rechnerübungen statt und erfolgt durch Demonstration eurer Lösung am Rechner.
KW | Mo | Di | Mi | Do | Fr | Themen |
---|---|---|---|---|---|---|
42 | 17.10 | 18.10 | 19.10 | 20.10 | 21.10 | BS VL1: Organisation und Einleitung |
BS VL1 | ||||||
43 | 24.10 | 25.10 | 26.10 | 27.10 | 28.10 | BS VL2: Einstieg in die Betriebssystementwicklung TÜ A1: Ausgabefunktionen und Tastaturansteuerung |
BS VL2 | TÜ A1 | |||||
44 | 31.10 | 01.11 | 02.11 | 03.11 | 04.11 | TÜ A1: Ausgabefunktionen und Tastaturansteuerung BS VL3: Unterbrechungen, Hardware TÜ A2: Interruptbehandlung für OOStuBS/MPStuBS |
TÜ A1 | BS VL3 | TÜ A2 | ||||
45 | 07.11 | 08.11 | 09.11 | 10.11 | 11.11 | TÜ A2: Interruptbehandlung für OOStuBS/MPStuBS BS VL4: Unterbrechungen - Software |
TÜ A2 | BS VL4 | Abgabe A1 | ||||
46 | 14.11 | 15.11 | 16.11 | 17.11 | 18.11 | BS VL5: Unterbrechungen - Synchronisation TÜ A3: Interruptsynchronisation mit dem Pro-/Epilogmodell |
Abgabe A1 | BS VL5 | TÜ A3 | ||||
47 | 21.11 | 22.11 | 23.11 | 24.11 | 25.11 | TÜ A3: Interruptsynchronisation mit dem Pro-/Epilogmodell BS VL6: IA-32: Die 32-Bit-Intel-Architektur |
TÜ A3 | BS VL6 | Abgabe A2 | ||||
48 | 28.11 | 29.11 | 30.11 | 01.12 | 02.12 | BS VL7: Koroutinen und Programmfäden TÜ A4: Threadumschaltung |
Abgabe A2 | BS VL7 | TÜ A4 | ||||
49 | 05.12 | 06.12 | 07.12 | 08.12 | 09.12 | TÜ A4: Threadumschaltung BS VL8: Scheduling |
TÜ A4 | BS VL8 | Abgabe A3 | ||||
50 | 12.12 | 13.12 | 14.12 | 15.12 | 16.12 | BS VL9: Betriebssystem-Architekturen TÜ A5: Zeitscheibenscheduling für OOStuBS/MPStuBS |
Abgabe A3 | BS VL9 | (nur RÜ) | ||||
51 | 19.12 | 20.12 | 21.12 | 22.12 | 23.12 | |
(nur RÜ) | (nur RÜ) | |||||
52 | 26.12 | 27.12 | 28.12 | 29.12 | 30.12 | |
Weihnachten | ||||||
01 | 02.01 | 03.01 | 04.01 | 05.01 | 06.01 | |
Weihnachten | ||||||
02 | 09.01 | 10.01 | 11.01 | 12.01 | 13.01 | TÜ A5: Zeitscheibenscheduling für OOStuBS/MPStuBS BS VL10: Fadensynchronisation |
TÜ A5 | BS VL10 | TÜ A5 | ||||
03 | 16.01 | 17.01 | 18.01 | 19.01 | 20.01 | BS VL11: Gerätetreiber |
Abgabe A4 | BS VL11 | Abgabe A4 | ||||
04 | 23.01 | 24.01 | 25.01 | 26.01 | 27.01 | TÜ A6: Ereignisbearbeitung und Synchronisation TÜ A7: Eine Anwendung für OOStuBS/MPStuBS (freiwillig) BS VL12: Interprozesskommunikation |
TÜ A6/A7 | BS VL12 | TÜ A6/A7 | ||||
05 | 30.01 | 31.01 | 01.02 | 02.02 | 03.02 | BS VL13: Zusammenfassung und Ausblick |
Abgabe A5 | BS VL13 | Abgabe A5 | ||||
06 | 06.02 | 07.02 | 08.02 | 09.02 | 10.02 | |
Abgabe A6 | Abgabe A6 |